RTEMS 6.1-rc1
Data Structures | Macros | Typedefs
alt_sysmgr.h File Reference
Board Support Packages » ARM » Intel Cyclone V » Contributed Code

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Data Structures

struct  ALT_SYSMGR_SILICONID1_s
 
struct  ALT_SYSMGR_SILICONID2_s
 
struct  ALT_SYSMGR_WDDBG_s
 
struct  ALT_SYSMGR_BOOT_s
 
struct  ALT_SYSMGR_HPSINFO_s
 
struct  ALT_SYSMGR_PARITYINJ_s
 
struct  ALT_SYSMGR_FPGAINTF_GBL_s
 
struct  ALT_SYSMGR_FPGAINTF_INDIV_s
 
struct  ALT_SYSMGR_FPGAINTF_MODULE_s
 
struct  ALT_SYSMGR_FPGAINTF_s
 
struct  ALT_SYSMGR_FPGAINTF_raw_s
 
struct  ALT_SYSMGR_SCANMGR_CTL_s
 
struct  ALT_SYSMGR_SCANMGR_s
 
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struct  ALT_SYSMGR_FRZCTL_HWCTL_s
 
struct  ALT_SYSMGR_FRZCTL_s
 
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struct  ALT_SYSMGR_ECC_EMAC1_s
 
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struct  ALT_SYSMGR_PINMUX_GPLMUX61_s
 
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struct  ALT_SYSMGR_PINMUX_GPLMUX65_s
 
struct  ALT_SYSMGR_PINMUX_GPLMUX66_s
 
struct  ALT_SYSMGR_PINMUX_GPLMUX67_s
 
struct  ALT_SYSMGR_PINMUX_GPLMUX68_s
 
struct  ALT_SYSMGR_PINMUX_GPLMUX69_s
 
struct  ALT_SYSMGR_PINMUX_GPLMUX70_s
 
struct  ALT_SYSMGR_PINMUX_NANDUSEFPGA_s
 
struct  ALT_SYSMGR_PINMUX_RGMII1USEFPGA_s
 
struct  ALT_SYSMGR_PINMUX_I2C0USEFPGA_s
 
struct  ALT_SYSMGR_PINMUX_RGMII0USEFPGA_s
 
struct  ALT_SYSMGR_PINMUX_I2C3USEFPGA_s
 
struct  ALT_SYSMGR_PINMUX_I2C2USEFPGA_s
 
struct  ALT_SYSMGR_PINMUX_I2C1USEFPGA_s
 
struct  ALT_SYSMGR_PINMUX_SPIM1USEFPGA_s
 
struct  ALT_SYSMGR_PINMUX_SPIM0USEFPGA_s
 
struct  ALT_SYSMGR_PINMUX_s
 
struct  ALT_SYSMGR_PINMUX_raw_s
 
struct  ALT_SYSMGR_s
 
struct  ALT_SYSMGR_raw_s
 

Macros

#define ALT_SYSMGR_SILICONID1_REV_E_REV1   0x1
 
#define ALT_SYSMGR_SILICONID1_REV_LSB   0
 
#define ALT_SYSMGR_SILICONID1_REV_MSB   15
 
#define ALT_SYSMGR_SILICONID1_REV_WIDTH   16
 
#define ALT_SYSMGR_SILICONID1_REV_SET_MSK   0x0000ffff
 
#define ALT_SYSMGR_SILICONID1_REV_CLR_MSK   0xffff0000
 
#define ALT_SYSMGR_SILICONID1_REV_RESET   0x1
 
#define ALT_SYSMGR_SILICONID1_REV_GET(value)   (((value) & 0x0000ffff) >> 0)
 
#define ALT_SYSMGR_SILICONID1_REV_SET(value)   (((value) << 0) & 0x0000ffff)
 
#define ALT_SYSMGR_SILICONID1_ID_E_CYCLONEV_ARRIAV   0x0
 
#define ALT_SYSMGR_SILICONID1_ID_LSB   16
 
#define ALT_SYSMGR_SILICONID1_ID_MSB   31
 
#define ALT_SYSMGR_SILICONID1_ID_WIDTH   16
 
#define ALT_SYSMGR_SILICONID1_ID_SET_MSK   0xffff0000
 
#define ALT_SYSMGR_SILICONID1_ID_CLR_MSK   0x0000ffff
 
#define ALT_SYSMGR_SILICONID1_ID_RESET   0x0
 
#define ALT_SYSMGR_SILICONID1_ID_GET(value)   (((value) & 0xffff0000) >> 16)
 
#define ALT_SYSMGR_SILICONID1_ID_SET(value)   (((value) << 16) & 0xffff0000)
 
#define ALT_SYSMGR_SILICONID1_OFST   0x0
 
#define ALT_SYSMGR_SILICONID2_RSV_LSB   0
 
#define ALT_SYSMGR_SILICONID2_RSV_MSB   31
 
#define ALT_SYSMGR_SILICONID2_RSV_WIDTH   32
 
#define ALT_SYSMGR_SILICONID2_RSV_SET_MSK   0xffffffff
 
#define ALT_SYSMGR_SILICONID2_RSV_CLR_MSK   0x00000000
 
#define ALT_SYSMGR_SILICONID2_RSV_RESET   0x0
 
#define ALT_SYSMGR_SILICONID2_RSV_GET(value)   (((value) & 0xffffffff) >> 0)
 
#define ALT_SYSMGR_SILICONID2_RSV_SET(value)   (((value) << 0) & 0xffffffff)
 
#define ALT_SYSMGR_SILICONID2_OFST   0x4
 
#define ALT_SYSMGR_WDDBG_MOD_0_E_CONTINUE   0x0
 
#define ALT_SYSMGR_WDDBG_MOD_0_E_PAUSECPU0   0x1
 
#define ALT_SYSMGR_WDDBG_MOD_0_E_PAUSECPU1   0x2
 
#define ALT_SYSMGR_WDDBG_MOD_0_E_PAUSEEITHER   0x3
 
#define ALT_SYSMGR_WDDBG_MOD_0_LSB   0
 
#define ALT_SYSMGR_WDDBG_MOD_0_MSB   1
 
#define ALT_SYSMGR_WDDBG_MOD_0_WIDTH   2
 
#define ALT_SYSMGR_WDDBG_MOD_0_SET_MSK   0x00000003
 
#define ALT_SYSMGR_WDDBG_MOD_0_CLR_MSK   0xfffffffc
 
#define ALT_SYSMGR_WDDBG_MOD_0_RESET   0x3
 
#define ALT_SYSMGR_WDDBG_MOD_0_GET(value)   (((value) & 0x00000003) >> 0)
 
#define ALT_SYSMGR_WDDBG_MOD_0_SET(value)   (((value) << 0) & 0x00000003)
 
#define ALT_SYSMGR_WDDBG_MOD_1_E_CONTINUE   0x0
 
#define ALT_SYSMGR_WDDBG_MOD_1_E_PAUSECPU0   0x1
 
#define ALT_SYSMGR_WDDBG_MOD_1_E_PAUSECPU1   0x2
 
#define ALT_SYSMGR_WDDBG_MOD_1_E_PAUSEEITHER   0x3
 
#define ALT_SYSMGR_WDDBG_MOD_1_LSB   2
 
#define ALT_SYSMGR_WDDBG_MOD_1_MSB   3
 
#define ALT_SYSMGR_WDDBG_MOD_1_WIDTH   2
 
#define ALT_SYSMGR_WDDBG_MOD_1_SET_MSK   0x0000000c
 
#define ALT_SYSMGR_WDDBG_MOD_1_CLR_MSK   0xfffffff3
 
#define ALT_SYSMGR_WDDBG_MOD_1_RESET   0x3
 
#define ALT_SYSMGR_WDDBG_MOD_1_GET(value)   (((value) & 0x0000000c) >> 2)
 
#define ALT_SYSMGR_WDDBG_MOD_1_SET(value)   (((value) << 2) & 0x0000000c)
 
#define ALT_SYSMGR_WDDBG_OFST   0x10
 
#define ALT_SYSMGR_BOOT_BSEL_E_RSVD   0x0
 
#define ALT_SYSMGR_BOOT_BSEL_E_FPGA   0x1
 
#define ALT_SYSMGR_BOOT_BSEL_E_NAND_FLSH_1_8V   0x2
 
#define ALT_SYSMGR_BOOT_BSEL_E_NAND_FLSH_3_0V   0x3
 
#define ALT_SYSMGR_BOOT_BSEL_E_SD_MMC_EXTERNAL_TRANSCEIVER_1_8V   0x4
 
#define ALT_SYSMGR_BOOT_BSEL_E_SD_MMC_INTERNAL_TRANSCEIVER_3_0V   0x5
 
#define ALT_SYSMGR_BOOT_BSEL_E_QSPI_FLSH_1_8V   0x6
 
#define ALT_SYSMGR_BOOT_BSEL_E_QSPI_FLSH_3_0V   0x7
 
#define ALT_SYSMGR_BOOT_BSEL_LSB   0
 
#define ALT_SYSMGR_BOOT_BSEL_MSB   2
 
#define ALT_SYSMGR_BOOT_BSEL_WIDTH   3
 
#define ALT_SYSMGR_BOOT_BSEL_SET_MSK   0x00000007
 
#define ALT_SYSMGR_BOOT_BSEL_CLR_MSK   0xfffffff8
 
#define ALT_SYSMGR_BOOT_BSEL_RESET   0x0
 
#define ALT_SYSMGR_BOOT_BSEL_GET(value)   (((value) & 0x00000007) >> 0)
 
#define ALT_SYSMGR_BOOT_BSEL_SET(value)   (((value) << 0) & 0x00000007)
 
#define ALT_SYSMGR_BOOT_CSEL_E_CSEL_0   0x0
 
#define ALT_SYSMGR_BOOT_CSEL_E_CSEL_1   0x1
 
#define ALT_SYSMGR_BOOT_CSEL_E_CSEL_2   0x2
 
#define ALT_SYSMGR_BOOT_CSEL_E_CSEL_3   0x3
 
#define ALT_SYSMGR_BOOT_CSEL_LSB   3
 
#define ALT_SYSMGR_BOOT_CSEL_MSB   4
 
#define ALT_SYSMGR_BOOT_CSEL_WIDTH   2
 
#define ALT_SYSMGR_BOOT_CSEL_SET_MSK   0x00000018
 
#define ALT_SYSMGR_BOOT_CSEL_CLR_MSK   0xffffffe7
 
#define ALT_SYSMGR_BOOT_CSEL_RESET   0x0
 
#define ALT_SYSMGR_BOOT_CSEL_GET(value)   (((value) & 0x00000018) >> 3)
 
#define ALT_SYSMGR_BOOT_CSEL_SET(value)   (((value) << 3) & 0x00000018)
 
#define ALT_SYSMGR_BOOT_PINBSEL_LSB   5
 
#define ALT_SYSMGR_BOOT_PINBSEL_MSB   7
 
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#define ALT_SYSMGR_PARITYINJ_DCOUTER_1_MSB   5
 
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#define ALT_SYSMGR_PARITYINJ_ICDATA_0_MSB   8
 
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#define ALT_SYSMGR_PARITYINJ_ICDATA_1_MSB   9
 
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#define ALT_SYSMGR_PARITYINJ_ICTAG_0_MSB   10
 
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#define ALT_SYSMGR_PARITYINJ_ICTAG_1_MSB   11
 
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#define ALT_SYSMGR_PARITYINJ_GHB_0_MSB   12
 
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#define ALT_SYSMGR_PARITYINJ_GHB_1_MSB   13
 
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#define ALT_SYSMGR_PARITYINJ_BTAC_0_MSB   14
 
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#define ALT_SYSMGR_PARITYINJ_BTAC_1_MSB   15
 
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#define ALT_SYSMGR_FPGAINTF_INDIV_CFGIOINTF_E_EN   0x1
 
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#define ALT_SYSMGR_FPGAINTF_INDIV_CFGIOINTF_MSB   2
 
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#define ALT_SYSMGR_FPGAINTF_INDIV_CFGIOINTF_SET(value)   (((value) << 2) & 0x00000004)
 
#define ALT_SYSMGR_FPGAINTF_INDIV_BSCANINTF_E_DIS   0x0
 
#define ALT_SYSMGR_FPGAINTF_INDIV_BSCANINTF_E_EN   0x1
 
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#define ALT_SYSMGR_FPGAINTF_INDIV_BSCANINTF_MSB   3
 
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#define ALT_SYSMGR_FPGAINTF_INDIV_BSCANINTF_GET(value)   (((value) & 0x00000008) >> 3)
 
#define ALT_SYSMGR_FPGAINTF_INDIV_BSCANINTF_SET(value)   (((value) << 3) & 0x00000008)
 
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#define ALT_SYSMGR_FPGAINTF_INDIV_TRACEINTF_MSB   4
 
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#define ALT_SYSMGR_FPGAINTF_INDIV_STMEVENTINTF_E_EN   0x1
 
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#define ALT_SYSMGR_FPGAINTF_INDIV_STMEVENTINTF_MSB   6
 
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#define ALT_SYSMGR_FRZCTL_HIOCTL_WKPULLUP_MSB   3
 
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#define ALT_SYSMGR_FRZCTL_HIOCTL_WKPULLUP_GET(value)   (((value) & 0x00000008) >> 3)
 
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#define ALT_SYSMGR_FRZCTL_HIOCTL_SLEW_MSB   4
 
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#define ALT_SYSMGR_FRZCTL_HIOCTL_SLEW_GET(value)   (((value) & 0x00000010) >> 4)
 
#define ALT_SYSMGR_FRZCTL_HIOCTL_SLEW_SET(value)   (((value) << 4) & 0x00000010)
 
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#define ALT_SYSMGR_FRZCTL_HIOCTL_DLLRST_MSB   5
 
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#define ALT_SYSMGR_FRZCTL_HIOCTL_DLLRST_SET(value)   (((value) << 5) & 0x00000020)
 
#define ALT_SYSMGR_FRZCTL_HIOCTL_OCTRST_E_DIS   0x0
 
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#define ALT_SYSMGR_FRZCTL_HIOCTL_OCTRST_MSB   6
 
#define ALT_SYSMGR_FRZCTL_HIOCTL_OCTRST_WIDTH   1
 
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#define ALT_SYSMGR_FRZCTL_HIOCTL_OCTRST_GET(value)   (((value) & 0x00000040) >> 6)
 
#define ALT_SYSMGR_FRZCTL_HIOCTL_OCTRST_SET(value)   (((value) << 6) & 0x00000040)
 
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#define ALT_SYSMGR_FRZCTL_HIOCTL_REGRST_MSB   7
 
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#define ALT_SYSMGR_FRZCTL_HIOCTL_REGRST_GET(value)   (((value) & 0x00000080) >> 7)
 
#define ALT_SYSMGR_FRZCTL_HIOCTL_REGRST_SET(value)   (((value) << 7) & 0x00000080)
 
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#define ALT_SYSMGR_FRZCTL_HIOCTL_OCT_CFGEN_CALSTART_MSB   8
 
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#define ALT_SYSMGR_FRZCTL_HIOCTL_OCT_CFGEN_CALSTART_SET(value)   (((value) << 8) & 0x00000100)
 
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#define ALT_SYSMGR_FRZCTL_SRC_VIO1_RESET   0x0
 
#define ALT_SYSMGR_FRZCTL_SRC_VIO1_GET(value)   (((value) & 0x00000001) >> 0)
 
#define ALT_SYSMGR_FRZCTL_SRC_VIO1_SET(value)   (((value) << 0) & 0x00000001)
 
#define ALT_SYSMGR_FRZCTL_SRC_OFST   0x14
 
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#define ALT_SYSMGR_FRZCTL_HWCTL_VIO1REQ_MSB   0
 
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#define ALT_SYSMGR_FRZCTL_HWCTL_VIO1REQ_SET_MSK   0x00000001
 
#define ALT_SYSMGR_FRZCTL_HWCTL_VIO1REQ_CLR_MSK   0xfffffffe
 
#define ALT_SYSMGR_FRZCTL_HWCTL_VIO1REQ_RESET   0x1
 
#define ALT_SYSMGR_FRZCTL_HWCTL_VIO1REQ_GET(value)   (((value) & 0x00000001) >> 0)
 
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#define ALT_SYSMGR_FRZCTL_HWCTL_VIO1STATE_LSB   1
 
#define ALT_SYSMGR_FRZCTL_HWCTL_VIO1STATE_MSB   2
 
#define ALT_SYSMGR_FRZCTL_HWCTL_VIO1STATE_WIDTH   2
 
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#define ALT_SYSMGR_FRZCTL_HWCTL_VIO1STATE_CLR_MSK   0xfffffff9
 
#define ALT_SYSMGR_FRZCTL_HWCTL_VIO1STATE_RESET   0x2
 
#define ALT_SYSMGR_FRZCTL_HWCTL_VIO1STATE_GET(value)   (((value) & 0x00000006) >> 1)
 
#define ALT_SYSMGR_FRZCTL_HWCTL_VIO1STATE_SET(value)   (((value) << 1) & 0x00000006)
 
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#define ALT_SYSMGR_EMAC_CTL_PHYSEL_0_E_RGMII   0x1
 
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#define ALT_SYSMGR_EMAC_CTL_PHYSEL_0_CLR_MSK   0xfffffffc
 
#define ALT_SYSMGR_EMAC_CTL_PHYSEL_0_RESET   0x2
 
#define ALT_SYSMGR_EMAC_CTL_PHYSEL_0_GET(value)   (((value) & 0x00000003) >> 0)
 
#define ALT_SYSMGR_EMAC_CTL_PHYSEL_0_SET(value)   (((value) << 0) & 0x00000003)
 
#define ALT_SYSMGR_EMAC_CTL_PHYSEL_1_E_GMII_MII   0x0
 
#define ALT_SYSMGR_EMAC_CTL_PHYSEL_1_E_RGMII   0x1
 
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#define ALT_SYSMGR_DMA_CTL_CHANSEL_1_MSB   1
 
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#define ALT_SYSMGR_DMA_CTL_CHANSEL_2_MSB   2
 
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#define ALT_SYSMGR_DMA_CTL_CHANSEL_3_MSB   3
 
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#define ALT_SYSMGR_DMA_CTL_MGRNONSECURE_MSB   4
 
#define ALT_SYSMGR_DMA_CTL_MGRNONSECURE_WIDTH   1
 
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#define ALT_SYSMGR_DMA_CTL_MGRNONSECURE_GET(value)   (((value) & 0x00000010) >> 4)
 
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#define ALT_SYSMGR_ISW_HANDOFF_VALUE_MSB   31
 
#define ALT_SYSMGR_ISW_HANDOFF_VALUE_WIDTH   32
 
#define ALT_SYSMGR_ISW_HANDOFF_VALUE_SET_MSK   0xffffffff
 
#define ALT_SYSMGR_ISW_HANDOFF_VALUE_CLR_MSK   0x00000000
 
#define ALT_SYSMGR_ISW_HANDOFF_VALUE_RESET   0x0
 
#define ALT_SYSMGR_ISW_HANDOFF_VALUE_GET(value)   (((value) & 0xffffffff) >> 0)
 
#define ALT_SYSMGR_ISW_HANDOFF_VALUE_SET(value)   (((value) << 0) & 0xffffffff)
 
#define ALT_SYSMGR_ISW_HANDOFF_OFST   0x0
 
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#define ALT_SYSMGR_ROMCODE_CTL_WARMRSTCFGPINMUX_LSB   0
 
#define ALT_SYSMGR_ROMCODE_CTL_WARMRSTCFGPINMUX_MSB   0
 
#define ALT_SYSMGR_ROMCODE_CTL_WARMRSTCFGPINMUX_WIDTH   1
 
#define ALT_SYSMGR_ROMCODE_CTL_WARMRSTCFGPINMUX_SET_MSK   0x00000001
 
#define ALT_SYSMGR_ROMCODE_CTL_WARMRSTCFGPINMUX_CLR_MSK   0xfffffffe
 
#define ALT_SYSMGR_ROMCODE_CTL_WARMRSTCFGPINMUX_RESET   0x0
 
#define ALT_SYSMGR_ROMCODE_CTL_WARMRSTCFGPINMUX_GET(value)   (((value) & 0x00000001) >> 0)
 
#define ALT_SYSMGR_ROMCODE_CTL_WARMRSTCFGPINMUX_SET(value)   (((value) << 0) & 0x00000001)
 
#define ALT_SYSMGR_ROMCODE_CTL_WARMRSTCFGIO_E_DISD   0x0
 
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#define ALT_SYSMGR_ROMCODE_CTL_WARMRSTCFGIO_GET(value)   (((value) & 0x00000002) >> 1)
 
#define ALT_SYSMGR_ROMCODE_CTL_WARMRSTCFGIO_SET(value)   (((value) << 1) & 0x00000002)
 
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#define ALT_SYSMGR_ROMCODE_CPU1STARTADDR_VALUE_MSB   31
 
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#define ALT_SYSMGR_ROMCODE_CPU1STARTADDR_VALUE_GET(value)   (((value) & 0xffffffff) >> 0)
 
#define ALT_SYSMGR_ROMCODE_CPU1STARTADDR_VALUE_SET(value)   (((value) << 0) & 0xffffffff)
 
#define ALT_SYSMGR_ROMCODE_CPU1STARTADDR_OFST   0x4
 
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#define ALT_SYSMGR_SDMMC_L3MST_HPROTDATA_0_GET(value)   (((value) & 0x00000001) >> 0)
 
#define ALT_SYSMGR_SDMMC_L3MST_HPROTDATA_0_SET(value)   (((value) << 0) & 0x00000001)
 
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#define ALT_SYSMGR_SDMMC_L3MST_HPROTPRIV_0_MSB   1
 
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#define ALT_SYSMGR_SDMMC_L3MST_HPROTBUFF_0_MSB   2
 
#define ALT_SYSMGR_SDMMC_L3MST_HPROTBUFF_0_WIDTH   1
 
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#define ALT_SYSMGR_SDMMC_L3MST_HPROTCACHE_0_MSB   3
 
#define ALT_SYSMGR_SDMMC_L3MST_HPROTCACHE_0_WIDTH   1
 
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#define ALT_SYSMGR_SDMMC_L3MST_HPROTCACHE_0_SET(value)   (((value) << 3) & 0x00000008)
 
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#define ALT_SYSMGR_NAND_BOOTSTRAP_NOINIT_MSB   0
 
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#define ALT_SYSMGR_NAND_BOOTSTRAP_NOINIT_GET(value)   (((value) & 0x00000001) >> 0)
 
#define ALT_SYSMGR_NAND_BOOTSTRAP_NOINIT_SET(value)   (((value) << 0) & 0x00000001)
 
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#define ALT_SYSMGR_NAND_BOOTSTRAP_PAGE512_MSB   1
 
#define ALT_SYSMGR_NAND_BOOTSTRAP_PAGE512_WIDTH   1
 
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#define ALT_SYSMGR_NAND_BOOTSTRAP_PAGE512_GET(value)   (((value) & 0x00000002) >> 1)
 
#define ALT_SYSMGR_NAND_BOOTSTRAP_PAGE512_SET(value)   (((value) << 1) & 0x00000002)
 
#define ALT_SYSMGR_NAND_BOOTSTRAP_NOLDB0P0_LSB   2
 
#define ALT_SYSMGR_NAND_BOOTSTRAP_NOLDB0P0_MSB   2
 
#define ALT_SYSMGR_NAND_BOOTSTRAP_NOLDB0P0_WIDTH   1
 
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#define ALT_SYSMGR_NAND_BOOTSTRAP_NOLDB0P0_GET(value)   (((value) & 0x00000004) >> 2)
 
#define ALT_SYSMGR_NAND_BOOTSTRAP_NOLDB0P0_SET(value)   (((value) << 2) & 0x00000004)
 
#define ALT_SYSMGR_NAND_BOOTSTRAP_TWOROWADDR_LSB   3
 
#define ALT_SYSMGR_NAND_BOOTSTRAP_TWOROWADDR_MSB   3
 
#define ALT_SYSMGR_NAND_BOOTSTRAP_TWOROWADDR_WIDTH   1
 
#define ALT_SYSMGR_NAND_BOOTSTRAP_TWOROWADDR_SET_MSK   0x00000008
 
#define ALT_SYSMGR_NAND_BOOTSTRAP_TWOROWADDR_CLR_MSK   0xfffffff7
 
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#define ALT_SYSMGR_NAND_BOOTSTRAP_TWOROWADDR_GET(value)   (((value) & 0x00000008) >> 3)
 
#define ALT_SYSMGR_NAND_BOOTSTRAP_TWOROWADDR_SET(value)   (((value) << 3) & 0x00000008)
 
#define ALT_SYSMGR_NAND_BOOTSTRAP_OFST   0x0
 
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#define ALT_SYSMGR_NAND_L3MST_ARCACHE_0_E_RSVD5   0xc
 
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#define ALT_SYSMGR_NAND_L3MST_ARCACHE_0_E_CACHE_WRTHRU_ALLOC   0xe
 
#define ALT_SYSMGR_NAND_L3MST_ARCACHE_0_E_CACHE_WRBACK_ALLOC   0xf
 
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#define ALT_SYSMGR_USB_L3MST_HPROTPRIV_0_MSB   2
 
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#define ALT_SYSMGR_USB_L3MST_HPROTPRIV_1_MSB   3
 
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#define ALT_SYSMGR_USB_L3MST_HPROTPRIV_1_RESET   0x1
 
#define ALT_SYSMGR_USB_L3MST_HPROTPRIV_1_GET(value)   (((value) & 0x00000008) >> 3)
 
#define ALT_SYSMGR_USB_L3MST_HPROTPRIV_1_SET(value)   (((value) << 3) & 0x00000008)
 
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#define ALT_SYSMGR_USB_L3MST_HPROTBUFF_0_MSB   4
 
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#define ALT_SYSMGR_USB_L3MST_HPROTBUFF_0_GET(value)   (((value) & 0x00000010) >> 4)
 
#define ALT_SYSMGR_USB_L3MST_HPROTBUFF_0_SET(value)   (((value) << 4) & 0x00000010)
 
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#define ALT_SYSMGR_USB_L3MST_HPROTBUFF_1_MSB   5
 
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#define ALT_SYSMGR_USB_L3MST_HPROTBUFF_1_GET(value)   (((value) & 0x00000020) >> 5)
 
#define ALT_SYSMGR_USB_L3MST_HPROTBUFF_1_SET(value)   (((value) << 5) & 0x00000020)
 
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#define ALT_SYSMGR_USB_L3MST_HPROTCACHE_0_MSB   6
 
#define ALT_SYSMGR_USB_L3MST_HPROTCACHE_0_WIDTH   1
 
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#define ALT_SYSMGR_USB_L3MST_HPROTCACHE_0_GET(value)   (((value) & 0x00000040) >> 6)
 
#define ALT_SYSMGR_USB_L3MST_HPROTCACHE_0_SET(value)   (((value) << 6) & 0x00000040)
 
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#define ALT_SYSMGR_USB_L3MST_HPROTCACHE_1_MSB   7
 
#define ALT_SYSMGR_USB_L3MST_HPROTCACHE_1_WIDTH   1
 
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#define ALT_SYSMGR_USB_L3MST_HPROTCACHE_1_RESET   0x0
 
#define ALT_SYSMGR_USB_L3MST_HPROTCACHE_1_GET(value)   (((value) & 0x00000080) >> 7)
 
#define ALT_SYSMGR_USB_L3MST_HPROTCACHE_1_SET(value)   (((value) << 7) & 0x00000080)
 
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#define ALT_SYSMGR_ECC_L2_EN_MSB   0
 
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#define ALT_SYSMGR_ECC_L2_EN_GET(value)   (((value) & 0x00000001) >> 0)
 
#define ALT_SYSMGR_ECC_L2_EN_SET(value)   (((value) << 0) & 0x00000001)
 
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#define ALT_SYSMGR_ECC_L2_INJS_MSB   1
 
#define ALT_SYSMGR_ECC_L2_INJS_WIDTH   1
 
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#define ALT_SYSMGR_ECC_L2_INJS_GET(value)   (((value) & 0x00000002) >> 1)
 
#define ALT_SYSMGR_ECC_L2_INJS_SET(value)   (((value) << 1) & 0x00000002)
 
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#define ALT_SYSMGR_ECC_L2_INJD_MSB   2
 
#define ALT_SYSMGR_ECC_L2_INJD_WIDTH   1
 
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#define ALT_SYSMGR_ECC_L2_INJD_CLR_MSK   0xfffffffb
 
#define ALT_SYSMGR_ECC_L2_INJD_RESET   0x0
 
#define ALT_SYSMGR_ECC_L2_INJD_GET(value)   (((value) & 0x00000004) >> 2)
 
#define ALT_SYSMGR_ECC_L2_INJD_SET(value)   (((value) << 2) & 0x00000004)
 
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#define ALT_SYSMGR_ECC_OCRAM_EN_MSB   0
 
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#define ALT_SYSMGR_ECC_OCRAM_EN_CLR_MSK   0xfffffffe
 
#define ALT_SYSMGR_ECC_OCRAM_EN_RESET   0x0
 
#define ALT_SYSMGR_ECC_OCRAM_EN_GET(value)   (((value) & 0x00000001) >> 0)
 
#define ALT_SYSMGR_ECC_OCRAM_EN_SET(value)   (((value) << 0) & 0x00000001)
 
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#define ALT_SYSMGR_ECC_OCRAM_INJS_MSB   1
 
#define ALT_SYSMGR_ECC_OCRAM_INJS_WIDTH   1
 
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#define ALT_SYSMGR_ECC_OCRAM_INJS_CLR_MSK   0xfffffffd
 
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#define ALT_SYSMGR_ECC_OCRAM_INJS_GET(value)   (((value) & 0x00000002) >> 1)
 
#define ALT_SYSMGR_ECC_OCRAM_INJS_SET(value)   (((value) << 1) & 0x00000002)
 
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#define ALT_SYSMGR_ECC_OCRAM_INJD_MSB   2
 
#define ALT_SYSMGR_ECC_OCRAM_INJD_WIDTH   1
 
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#define ALT_SYSMGR_ECC_OCRAM_INJD_GET(value)   (((value) & 0x00000004) >> 2)
 
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#define ALT_SYSMGR_ECC_OCRAM_SERR_MSB   3
 
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#define ALT_SYSMGR_ECC_OCRAM_DERR_MSB   4
 
#define ALT_SYSMGR_ECC_OCRAM_DERR_WIDTH   1
 
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#define ALT_SYSMGR_ECC_OCRAM_DERR_GET(value)   (((value) & 0x00000010) >> 4)
 
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#define ALT_SYSMGR_ECC_USB0_EN_MSB   0
 
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#define ALT_SYSMGR_ECC_USB0_INJS_MSB   1
 
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#define ALT_SYSMGR_ECC_USB0_INJS_GET(value)   (((value) & 0x00000002) >> 1)
 
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#define ALT_SYSMGR_ECC_USB0_INJD_MSB   2
 
#define ALT_SYSMGR_ECC_USB0_INJD_WIDTH   1
 
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#define ALT_SYSMGR_ECC_USB0_SERR_LSB   3
 
#define ALT_SYSMGR_ECC_USB0_SERR_MSB   3
 
#define ALT_SYSMGR_ECC_USB0_SERR_WIDTH   1
 
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#define ALT_SYSMGR_ECC_USB0_SERR_GET(value)   (((value) & 0x00000008) >> 3)
 
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#define ALT_SYSMGR_ECC_USB0_DERR_MSB   4
 
#define ALT_SYSMGR_ECC_USB0_DERR_WIDTH   1
 
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#define ALT_SYSMGR_ECC_USB0_DERR_GET(value)   (((value) & 0x00000010) >> 4)
 
#define ALT_SYSMGR_ECC_USB0_DERR_SET(value)   (((value) << 4) & 0x00000010)
 
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#define ALT_SYSMGR_ECC_USB1_EN_MSB   0
 
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#define ALT_SYSMGR_ECC_USB1_EN_GET(value)   (((value) & 0x00000001) >> 0)
 
#define ALT_SYSMGR_ECC_USB1_EN_SET(value)   (((value) << 0) & 0x00000001)
 
#define ALT_SYSMGR_ECC_USB1_INJS_LSB   1
 
#define ALT_SYSMGR_ECC_USB1_INJS_MSB   1
 
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#define ALT_SYSMGR_ECC_USB1_INJS_GET(value)   (((value) & 0x00000002) >> 1)
 
#define ALT_SYSMGR_ECC_USB1_INJS_SET(value)   (((value) << 1) & 0x00000002)
 
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#define ALT_SYSMGR_ECC_USB1_INJD_MSB   2
 
#define ALT_SYSMGR_ECC_USB1_INJD_WIDTH   1
 
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#define ALT_SYSMGR_ECC_USB1_INJD_CLR_MSK   0xfffffffb
 
#define ALT_SYSMGR_ECC_USB1_INJD_RESET   0x0
 
#define ALT_SYSMGR_ECC_USB1_INJD_GET(value)   (((value) & 0x00000004) >> 2)
 
#define ALT_SYSMGR_ECC_USB1_INJD_SET(value)   (((value) << 2) & 0x00000004)
 
#define ALT_SYSMGR_ECC_USB1_SERR_LSB   3
 
#define ALT_SYSMGR_ECC_USB1_SERR_MSB   3
 
#define ALT_SYSMGR_ECC_USB1_SERR_WIDTH   1
 
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#define ALT_SYSMGR_ECC_USB1_SERR_RESET   0x0
 
#define ALT_SYSMGR_ECC_USB1_SERR_GET(value)   (((value) & 0x00000008) >> 3)
 
#define ALT_SYSMGR_ECC_USB1_SERR_SET(value)   (((value) << 3) & 0x00000008)
 
#define ALT_SYSMGR_ECC_USB1_DERR_LSB   4
 
#define ALT_SYSMGR_ECC_USB1_DERR_MSB   4
 
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#define ALT_SYSMGR_ECC_EMAC1_RXFIFODERR_MSB   8
 
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#define ALT_SYSMGR_ECC_DMA_INJD_MSB   2
 
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#define ALT_SYSMGR_ECC_DMA_SERR_MSB   3
 
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#define ALT_SYSMGR_ECC_DMA_DERR_MSB   4
 
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#define ALT_SYSMGR_ECC_CAN0_INJS_MSB   1
 
#define ALT_SYSMGR_ECC_CAN0_INJS_WIDTH   1
 
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#define ALT_SYSMGR_ECC_CAN0_INJS_GET(value)   (((value) & 0x00000002) >> 1)
 
#define ALT_SYSMGR_ECC_CAN0_INJS_SET(value)   (((value) << 1) & 0x00000002)
 
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#define ALT_SYSMGR_ECC_CAN0_INJD_MSB   2
 
#define ALT_SYSMGR_ECC_CAN0_INJD_WIDTH   1
 
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#define ALT_SYSMGR_ECC_CAN0_SERR_MSB   3
 
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#define ALT_SYSMGR_ECC_NAND_ECCBUFSERR_MSB   7
 
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#define ALT_SYSMGR_ECC_NAND_ECCBUFDERR_MSB   8
 
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#define ALT_SYSMGR_ECC_NAND_WRFIFOSERR_MSB   9
 
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#define ALT_SYSMGR_ECC_NAND_WRFIFODERR_MSB   10
 
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#define ALT_SYSMGR_ECC_NAND_RDFIFOSERR_MSB   11
 
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#define ALT_SYSMGR_ECC_NAND_RDFIFOSERR_SET(value)   (((value) << 11) & 0x00000800)
 
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#define ALT_SYSMGR_ECC_NAND_RDFIFODERR_MSB   12
 
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#define ALT_SYSMGR_ECC_QSPI_INJS_MSB   1
 
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#define ALT_SYSMGR_ECC_QSPI_INJD_MSB   2
 
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#define ALT_SYSMGR_ECC_QSPI_SERR_MSB   3
 
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#define ALT_SYSMGR_ECC_QSPI_DERR_MSB   4
 
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#define ALT_SYSMGR_ECC_SDMMC_EN_MSB   0
 
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#define ALT_SYSMGR_ECC_SDMMC_EN_GET(value)   (((value) & 0x00000001) >> 0)
 
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#define ALT_SYSMGR_ECC_SDMMC_INJSPORTA_MSB   1
 
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#define ALT_SYSMGR_ECC_SDMMC_INJDPORTA_MSB   2
 
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#define ALT_SYSMGR_ECC_SDMMC_INJDPORTA_GET(value)   (((value) & 0x00000004) >> 2)
 
#define ALT_SYSMGR_ECC_SDMMC_INJDPORTA_SET(value)   (((value) << 2) & 0x00000004)
 
#define ALT_SYSMGR_ECC_SDMMC_INJSPORTB_LSB   3
 
#define ALT_SYSMGR_ECC_SDMMC_INJSPORTB_MSB   3
 
#define ALT_SYSMGR_ECC_SDMMC_INJSPORTB_WIDTH   1
 
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#define ALT_SYSMGR_ECC_SDMMC_INJSPORTB_GET(value)   (((value) & 0x00000008) >> 3)
 
#define ALT_SYSMGR_ECC_SDMMC_INJSPORTB_SET(value)   (((value) << 3) & 0x00000008)
 
#define ALT_SYSMGR_ECC_SDMMC_INJDPORTB_LSB   4
 
#define ALT_SYSMGR_ECC_SDMMC_INJDPORTB_MSB   4
 
#define ALT_SYSMGR_ECC_SDMMC_INJDPORTB_WIDTH   1
 
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#define ALT_SYSMGR_ECC_SDMMC_INJDPORTB_GET(value)   (((value) & 0x00000010) >> 4)
 
#define ALT_SYSMGR_ECC_SDMMC_INJDPORTB_SET(value)   (((value) << 4) & 0x00000010)
 
#define ALT_SYSMGR_ECC_SDMMC_SERRPORTA_LSB   5
 
#define ALT_SYSMGR_ECC_SDMMC_SERRPORTA_MSB   5
 
#define ALT_SYSMGR_ECC_SDMMC_SERRPORTA_WIDTH   1
 
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#define ALT_SYSMGR_ECC_SDMMC_SERRPORTA_GET(value)   (((value) & 0x00000020) >> 5)
 
#define ALT_SYSMGR_ECC_SDMMC_SERRPORTA_SET(value)   (((value) << 5) & 0x00000020)
 
#define ALT_SYSMGR_ECC_SDMMC_DERRPORTA_LSB   6
 
#define ALT_SYSMGR_ECC_SDMMC_DERRPORTA_MSB   6
 
#define ALT_SYSMGR_ECC_SDMMC_DERRPORTA_WIDTH   1
 
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#define ALT_SYSMGR_ECC_SDMMC_DERRPORTA_GET(value)   (((value) & 0x00000040) >> 6)
 
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#define ALT_SYSMGR_ECC_SDMMC_SERRPORTB_LSB   7
 
#define ALT_SYSMGR_ECC_SDMMC_SERRPORTB_MSB   7
 
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Typedefs

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